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Intel présente sa technologie de packaging de prochaine génération Glass Substrate, offrant des interconnexions supérieures

Intel présente sa technologie de packaging de prochaine génération Glass Substrate, offrant des interconnexions supérieures

Intel a présenté sa technologie de packaging de prochaine génération Glass Substrate qui remplacera les matériaux organiques existants et offrira des interconnexions supérieures.

L’emballage des puces de prochaine génération d’Intel comprendra un substrat en verre, offrant des améliorations significatives des interconnexions

La technologie présentée par Intel est “les substrats en verre”, qui remplacent l’emballage organique conventionnel actuellement utilisé sur les puces existantes. Avant d’entrer dans les détails de son fonctionnement, Intel affirme que “les substrats en verre” sont l’avenir, et que cette technologie de packaging pourrait permettre rapidement des innovations à grande échelle dans les industries, en particulier dans les domaines de l’HPC et de l’IA, étant donné que l’emballage des puces fait beaucoup parler de lui ces derniers temps.

Après une décennie de recherche, Intel a réussi à obtenir des substrats en verre de pointe pour l’emballage avancé. Nous sommes impatients de fournir ces technologies de pointe qui bénéficieront à nos principaux acteurs et clients fondeurs pendant des décennies.

– Babak Sabi, vice-président principal d’Intel

Un ingénieur d’Intel tient un panneau de substrat en verre d’essai dans les usines de développement de la technologie d’assemblage et de test d’Intel à Chandler, Arizona, en juillet 2023. Les technologies de packaging avancées d’Intel prennent vie dans les usines de développement de la technologie d’assemblage et de test de l’entreprise. (Crédit : Intel Corporation)

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L’élément essentiel qui rend une technologie de packaging de puce particulière supérieure est sa capacité à intégrer autant de “puces” dans un seul package. Avec les substrats en verre, Intel indique que les fabricants peuvent désormais utiliser des “complexes de puces plus grands”, ce qui permet de réduire l’encombrement d’un seul package, entraînant ainsi une amélioration beaucoup plus efficace et élevée des performances.

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